基于数字原理的电子系统变得越来越普遍了。对这些系统来说,最重要的是要有一个好的设计方法。自顶向下的方法是人们所推崇的。通地使用计算机建模来描述系统,可以大大简历化这种方法。VHDL是一种设计语言,允许设计人员先对基本的数字电路的特性和结构建模,然后,再自动实现高级描述的电路结构。
本书是为学习数字设计课程的学生和在实际工作中进行集成数字设计与VHDL综合的工作技术人员准备的。它把数字设计的原理和VHDL的使用指南结合起来了,同时讨论了系统综合问题并提供了改进模拟准确性和性能的实际原则。
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